Custom IC one-chip 설계/DIGITAL LOGIC GATE

[Digital Logic Gate]_XOR

juniha 2025. 5. 11. 21:58

Schematic

[그림 1] XOR_Schematic

 

Symbol

[그림 2] XOR_Symbol

 

Simualtion

[그림 3] XOR_Simulation_Schematic

 

[그림 3] XOR_Simulation

Layout

[그림 4] XOR_Layout


  • Layout size : 가로 1.72 µm
                          세로 5.6 µm

                              5.6 * 1.72  = 9.632 µm^2